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• 200 1_ |a CMOS PLL synthesizers |e analysis and design |d = CMOS锁相环 |e 分析和设计 |f Keliu Shu, Edgar Sanchez9Sinencio |z chi

• 205 __ |a 影印版

• 210 __ |a 北京 |c 科学出版社 |d 2007

• 215 __ |a 13, 215页 |c 图 |d 24cm

• 225 2_ |a 国外电子信息精品著作 |A Guo Wai Dian Zi Xin Xi Jing Pin Zhu Zuo

• 320 __ |a 有书目和索引

• 330 __ |a 本书作者分别从系统级和电路级对频率综合器的设计进行了阐述。

• 410 _0 |1 2001 |a 国外电子信息精品著作

• 510 1_ |a CMOS锁相环 |e 分析和设计 |z chi

• 606 0_ |a 锁相环 |A Suo Xiang Huan |x 电路设计 |x 英文

• 690 __ |a TN911.8 |v 4

• 701 _1 |a 舒, |A Shu |b K. |g (Shu, Keliu) |4 著

• 701 _1 |a 桑泽兹, |A Sang Ze Zi |b E. |g (Sanchez9Sinencio, Edgar) |4 著

• 801 _0 |a CN |b 江苏新华 |c 20070118

• 905 __ |a WXCSXY |d TN911.8/1